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AD8009ARZ 1 GHz、5500 V/μs 低失真放大器 國產運放

2023/4/18 10:03:08 點擊:
SC7508 是一款超高速電流反饋型放大器,壓擺率高達 5500 V/μs,上升時間僅為 545 ps,因而非常適合用作脈沖放大器。高壓擺率使大信號帶寬達到 440 MHz,從而滿足高分辨率視頻圖形系統的要求。信號質量在整個寬帶寬范圍內均保持較高水平,最差情況下的失真為–40 dBc(250 MHz,G = +10,1 V p-p)。對于多頻信號的應用,三階交調截點(3IP)可以到達 12 dBm。SC7508 可靈活地應用于 IF/RF 信號鏈中的增益級放大器。
SC7508 能夠提供 175 mA 以上的負載電流,在驅動四個視頻負載時,可以取得低差分增益和相位誤差(分別為 0.02%和 0.04°)。高驅動能力還體現在它能夠提供 10 dBm 的輸出功率,當頻率為70 MHz 時無雜散動態范圍(SFDR)約為–38 dBc。

SC7508 提供小型 SOIC 封裝,工作溫度范圍為–55°C 至+125°C。 

主要性能
?  超高速
壓擺率:5500 V/μs(4 V 階躍,G = +2)
上升時間:545 ps(2 V 階躍,G = +2)
大信號帶寬:
440 MHz,G = +2;320 MHz,G = +10
小信號帶寬(–3 dB):
1 GHz,G = +1;700 MHz,G = +2
0.1%建立時間為:10 ns(2 V 階躍,G = +2)
?  寬帶寬范圍內低失真
無雜散動態范圍(SFDR):
–66 dBc(20 MHz,二次諧波)
–75 dBc(20 MHz,三次諧波)
?  三階交調截點(3IP)
26 dBm(70 MHz,G = +10)
?  良好的視頻規格
0.1 dB 增益平坦度達 75 MHz
0.01%差分增益誤差,RL = 150 Ω
0.01° 差分相位誤差,RL = 150 Ω
?  高輸出驅動
175 mA 輸出負載驅動電流
10 dBm 且 SFDR 為–38 dBc(70 MHz,G = 
+10)
?  電源供電
電源電壓:+5 V 至±5 V 
電源電流:16mA(典型值)
應用場合
?  脈沖放大器
?  中頻/射頻增益級/放大器
?  高速儀器儀表
?  CCD 成像放大
?  高分辨率視頻圖形
功能模塊示意:

技術規格
特性 1
除非另有說明,TA = 25°C,VS = ±5 V,RL = 100 Ω;對于 R 封裝:RF = 301 Ω (G = +1, +2)、RF = 200 (G = +10);對于 RT 封裝:RF = 332 Ω (G = +1)、RF = 226 Ω (G = +2)和 RF = 191 Ω (G = +10)。

最大功耗
SC7508 安全工作的最大功耗受限于結溫的升高。塑封器件的最大安全結溫由塑料的玻璃化轉變溫度決定,約為 150°C。即便只是暫時超過此限值,由于封裝對芯片作用  的應力改變,參數性能也可能會發生變化。長時間超過 175°C 的結溫可能會導致器件失效。 
雖然 SC7508 提供內部短路保護,但這可能不足以保證所有情況下均不會超過最大結溫(150°C)。為了確保正常工作,必須觀察最大功率減額曲線。

典型應用信息
所有電流反饋型運算放大器均受負輸入端的寄生電容影響。一個電容與增益電阻并聯可以擴展帶寬。出于實際考慮,負輸入端到地的電容越大,則所需的 RF 也越大,以便最大程度降低峰化和振鈴。RF 濾波驅動器
SC7508 的輸出驅動能力、寬帶寬和低失真特性非常適合驅動 RF 濾波器的增益模塊。許多此類濾波器要求輸入端由 50Ω 源驅動,而輸出端則必須 50Ω 阻抗匹配,此類濾波器才能表現出額定的頻率響應。
SC7508 的增益設置為+2。輸出端的 50Ω 串聯電阻以及濾波器特征 50Ω 電阻,使得增益為1。

驅動容性負載
根據運算放大器的架構,利用運算放大器來驅動某些模數轉換器的容性負載可能是一大挑戰。大多數問題是運算放大器的輸出阻抗與其驅動電容構成的極點引起的。這會產生相移,最終使得運算放大器不穩定。
驅動電容時防止不穩定并改善建立時間的一種方式是在運算放大器輸出端和該電容之間插入一個串聯電阻。反饋電阻仍然直接連接到運算放大器的輸出端,而串聯電阻則在容性負載與運算放大器輸出端之間提供了一定的隔離。
圖 3 顯示了用 SC7508 驅動 50pF 負載的電路。RS=0 時,SC7508 電路會不穩定。增益為+2 和+10 時,實驗發現如果將 RS 設為 42.2Ω,輸出端采用 2V 階躍的 0.1%建立時間會降到最低。此電路的 0.1%建立時間經測量為 40 ns。
對于更小的容性負載,更小的 RS 會產生最優的建立時間,而對于更大的容性負載,則需要更大的 RS。當然,電容越大,建立至給定精度所需的時間就越長;同時,由于所需的 RS 增加,因此建立時間會更長。最好情況下大約七個時間常數來建立到 0.1%。



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